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Searched refs:pcie_lane (Results 1 – 14 of 14) sorted by relevance

/linux/drivers/gpu/drm/amd/pm/swsmu/smu11/
A Darcturus_ppt.h55 uint8_t pcie_lane[MAX_PCIE_CONF]; member
A Dnavi10_ppt.c1344 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 1) ? "x1" : in navi10_print_clk_levels()
1345 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 2) ? "x2" : in navi10_print_clk_levels()
1346 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 3) ? "x4" : in navi10_print_clk_levels()
1347 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 4) ? "x8" : in navi10_print_clk_levels()
1348 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 5) ? "x12" : in navi10_print_clk_levels()
1349 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 6) ? "x16" : "", in navi10_print_clk_levels()
1352 (lane_width == dpm_context->dpm_tables.pcie_table.pcie_lane[i]) ? in navi10_print_clk_levels()
2202 dpm_context->dpm_tables.pcie_table.pcie_lane[i] = pptable->PcieLaneCount[i]; in navi10_update_pcie_parameters()
2221 dpm_context->dpm_tables.pcie_table.pcie_lane[i] = pcie_width_cap; in navi10_update_pcie_parameters()
A Dsienna_cichlid_ppt.c1084 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 1) ? "x1" : in sienna_cichlid_print_clk_levels()
1085 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 2) ? "x2" : in sienna_cichlid_print_clk_levels()
1086 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 3) ? "x4" : in sienna_cichlid_print_clk_levels()
1087 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 4) ? "x8" : in sienna_cichlid_print_clk_levels()
1088 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 5) ? "x12" : in sienna_cichlid_print_clk_levels()
1089 (dpm_context->dpm_tables.pcie_table.pcie_lane[i] == 6) ? "x16" : "", in sienna_cichlid_print_clk_levels()
1092 (lane_width == dpm_context->dpm_tables.pcie_table.pcie_lane[i]) ? in sienna_cichlid_print_clk_levels()
1837 dpm_context->dpm_tables.pcie_table.pcie_lane[i] = table_member2[i]; in sienna_cichlid_update_pcie_parameters()
1859 dpm_context->dpm_tables.pcie_table.pcie_lane[i] = pcie_width_cap; in sienna_cichlid_update_pcie_parameters()
/linux/drivers/gpu/drm/amd/pm/swsmu/smu13/
A Daldebaran_ppt.h55 uint8_t pcie_lane[MAX_PCIE_CONF]; member
/linux/drivers/gpu/drm/amd/pm/powerplay/hwmgr/
A Dsmu7_hwmgr.c3710 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3712 ps->performance_levels[i].pcie_lane; in smu7_get_pp_table_entry_v1()
3714 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3716 ps->performance_levels[i].pcie_lane; in smu7_get_pp_table_entry_v1()
3734 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3739 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v1()
3859 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3864 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3884 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
3889 ps->performance_levels[i].pcie_lane) in smu7_get_pp_table_entry_v0()
[all …]
A Dsmu7_hwmgr.h58 uint16_t pcie_lane; member
A Dvega10_hwmgr.h142 uint8_t pcie_lane[MAX_PCIE_CONF]; member
A Dvega12_hwmgr.h121 uint8_t pcie_lane[MAX_PCIE_CONF]; member
A Dvega20_hwmgr.h173 uint8_t pcie_lane[MAX_PCIE_CONF]; member
A Dvega10_hwmgr.c1271 pcie_table->pcie_lane[i] = (uint8_t)encode_pcie_lane_width( in vega10_setup_default_pcie_table()
1274 pcie_table->pcie_lane[i] = (uint8_t)encode_pcie_lane_width( in vega10_setup_default_pcie_table()
1570 pp_table->PcieLaneCount[i] = pcie_table->pcie_lane[i]; in vega10_populate_smc_link_levels()
1583 pp_table->PcieLaneCount[i] = pcie_table->pcie_lane[j]; in vega10_populate_smc_link_levels()
/linux/drivers/gpu/drm/amd/pm/inc/
A Dsmu_v13_0.h78 uint8_t pcie_lane[MAX_PCIE_CONF]; member
A Dsmu_v11_0.h100 uint8_t pcie_lane[MAX_PCIE_CONF]; member
/linux/drivers/gpu/drm/radeon/
A Dci_dpm.h43 u16 pcie_lane; member
A Dci_dpm.c3739 state->performance_levels[0].pcie_lane, in ci_trim_dpm_states()
3741 state->performance_levels[high_limit_count].pcie_lane); in ci_trim_dpm_states()
5456 pl->pcie_lane = r600_get_pcie_lane_support(rdev, in ci_parse_pplib_clock_info()
5485 if (pi->pcie_lane_powersaving.max < pl->pcie_lane) in ci_parse_pplib_clock_info()
5486 pi->pcie_lane_powersaving.max = pl->pcie_lane; in ci_parse_pplib_clock_info()
5487 if (pi->pcie_lane_powersaving.min > pl->pcie_lane) in ci_parse_pplib_clock_info()
5488 pi->pcie_lane_powersaving.min = pl->pcie_lane; in ci_parse_pplib_clock_info()
5496 if (pi->pcie_lane_performance.max < pl->pcie_lane) in ci_parse_pplib_clock_info()
5497 pi->pcie_lane_performance.max = pl->pcie_lane; in ci_parse_pplib_clock_info()
5498 if (pi->pcie_lane_performance.min > pl->pcie_lane) in ci_parse_pplib_clock_info()
[all …]

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